We have designed and fabricated ASK modulator MMIC operating at 5.8GHz for OBE used in AGPS (Automatic Gate Passing System). ASK modulator MMIC was designed to apply a sing1e supply voltage of 3V to the drain in order to decrease ACP (Adjacent Channel Power). The measurement result of this chip exhibits on/off characteristic over 30dB. The design parameters are optimized through ADS simulation tool. The layouts and fabrication o( ASK Modulator MMIC were designed and fabricated by using ETRI 0.5${\mu}{\textrm}{m}$ MESFET library. The chip sizes were 1mm $\times$1mm. The performance analysis of the implemented ASK Modulator based on the design parameters is accomplished.
본 논문에서는 ITS 서비스를 위해 개발된 5.8 GHz대역 근거리 전용 무선 통신을 이용한 자동게이트통관시스템의 차량탑재장치(OBE) 구성요소 중 ASK 변조기를 설계 및 제작하였다. 제안된 ASK 변조기는 인접채널간섭을 줄이기 위하여 3 V 단일전압 드레인 제어 변조회로로 설계되었으며 0.7 - 3 V의 넓은 선형변조영역과 40 dB 이상의 On/off Ratio 특성을 얻었다. 회로의 Layout과 공정은 ETRI 0.5$\mu\textrm{m}$ MESFET Library를 사용하였고 칩 면적은 1.0mm $\times$ 1.0mmn로 제작하였다.
A double-balanced frequency up-converter using the Gilbert cell structure has been designed with the TSMC $0.18\;{\mu}m$ CMOS library. The frequency up-converter consists of a Mixer core and IF / LO balun. Frequency Up-converter exhibits a 3.4 dB conversion gain with a - 7.6 dBm $P_{1dB}$ for IF power of -10 dBm and LO power of 0 dBm inputs. It also exhibits 92.2 % modulation depth as a ASK modulator.
본 논문에서는 모바일 단말기의 키 버튼을 누르면 발생되는 DTMF 신호를 이용하여 자동 도어락 시스템을 제안하고 구현한다. 모바일 단말기의 DTMF신호처리를 위하여 이 시스템은 송신기 모듈과 수신기 모듈로 구성된다. 이어폰 잭으로 연결된 모바일 단말기의 DTMF신호들은DTMF수신기의 입력단자로 들어가서 4비트 형식을 갖는 부호변환기에 의해 이진신호로 부호화된다. 부호화된 출력신호들은 ASK 송신기 모듈로 전송되고 RF신호로 변조되어 자유공간으로 전파된다. 자유공간을 통하여 전달된 RF신호들은 수신기모듈인 ASK복조기에 의해 복조되고 MCU로 보내진다. MCU에 의해서 처리된 출력신호들은 이미 프로세서 내에 기록된 비밀번호와 비교되고 파워릴레이로 전달된다. 만약 비교된 결과 값이 일치하면 자동 도어락 시스템은 도어를 열게 되고 그 반대의 경우에는 도어를 닫은 상태를 유지한다. 본 논문에서 구현된 자동 도어락 시스템은 무선 환경에서 잘 동작한다.
본 논문에서는 배터리가 없는 ASK 전송방식의 RFID(Radio Frequency IDentification) Transponder 칩 설계에 관한 내용을 다룬다. Transponder IC는 power-generation 회로, clock-generation 회로, digital block, modulator, overoltge protection 회로로 구성된다. 설계된 칩은 저전력 회로를 적용하여 원거리 transponder칩을 구현할 수 있도록 하였다. 설계된 회로는 0.25㎛ 표준 CMOS 공정으로 레이아웃하여 제작하였다.
본 논문에서는 지능형 교통망(ITS)에 사용될 수 있도록 5.8 GHz 대역에서 경제적이며 초소형 RF 송신기 모듈을 구현하였다. LTCC 방식으로 설계하여 회로의 소형화와 함께 전기적 성능을 개선하였다. 제작된 모듈은 ASK 데이터 변조 장치, 주파수 합성기, 송신용 전력 증폭 회로 등으로 구성되었으며 모듈 크기는 0.8 CC이다. 측정결과 1.024 Mbps 데이터를 5.8 GHz의 주파수 대역으로 직접 ASK 변조시켜 출력 10 dBm 이상과 인접 채널 간섭비 -40 dBc 등의 RF 송신 성능을 나타낸다. 송신기의 신호원으로서 설계 제작된 주파수 합성기는 26 usec의 채널 이동시간(lock time)을 보여주며 중심 주파수에서 1 MHz 떨어진 지점에서 -115 dBc/Hz의 우수한 위상 잡음 특성을 나타낸다.
본 논문에서는 고속 데이터 무선인식에 적용 될 2.45㎓ 수동형 RF-ID 시스템을 개발하였다. RF-ID 시스템은 수동형 태그 와 리더로 구성되어 있다. RF-ID 수동형 태그는 제로 바이어스 쇼트키 다이오드를 사용한 정류기, ID 칩, ASK 변조회로 그리고 backscatter 슬롯 안테나로 구성되어있다. 또한, ASK 변조를 위한 스위칭 소자로서 바이폴라 트랜지스터를 이용하여 저전력 소모 변조회로를 구성하였으며 태그의 슬롯 안테나는 일반 패치 안테나보다 광대역 특성을 갖는다. RF-ID 리더는 circulator를 사용하여 단일 마이크로스트립 패치 어레이 안테나를 사용하였으며 종래의 방식에서 채택하는 double-balanced mixer구조를 사용하지 않고 single-balanced mixer구조를 채택함으로서 회로의 복잡성을 개선하고 전체적인 단말기 크기를 소형화 가능하도록 설계하였다. 측정결과 동작주파수는 2.4 GHz이고 출력은 27 dBm (500 mW)에서 감지거리 1 m로 나타났다. 리더에서 측정된 변조신호는 -46.76 dBm이며 주파수는 57.2 kHz이다.
An analog front-end circuit for 13.56MHz ISO/IECl4443 type B compatible RFID tags was designed. The designed circuit includes a rectifier and regulator to generate a stable DC voltage from the RF signal, an over-voltage limiter to protect the circuit from high voltages, an ASK demodulator to extract the data transferred from reader to tag, and a load modulator to transfer data from tag to reader. The functionality of the designed circuit has been verified through simulations using 0.25um CMOS process parameters.
Transactions on Electrical and Electronic Materials
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제11권1호
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pp.20-23
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2010
The analog front end (AFE) of a radio frequency identification transponder using the ISO 14443 type A standard with a 100% amplitude shift keying (ASK) modulation is proposed in this paper and verified by circuit simulations and measurements. This AFE circuit, using a 13.56 MHz carrier frequency, consists of a rectifier, a modulator, a demodulator, a regulator, a power on reset, and a dynamically enabled digital phase locked loop (DPLL). The DPLL, with a charge pump enable circuit, was used to recover the clock of a 100% modulated ASK signal during the pause period. A high voltage lateral double diffused metal-oxide semiconductor transistor was used to protect the rectifier and the clock recovery circuit from high voltages. The proposed AFE was fabricated using the $0.18\;{\mu}m$ standard CMOS process, with an AFE core size of $350\;{\mu}m\;{\times}\;230\;{\mu}m$. The measurement results show that the DPLL, using a demodulator output signal, generates a constant 1.695 MHz clock during the pause period of the 100% ASK signal.
기존의 대표적인 디지털 통신방식으로 주파수 편이 변조(FSK: frequency shift keying), 위상 편이 변조(PSK: phase shift keying), 진폭 편이 변조(ASK: amplitude shift keying) 방식들이 있다. 본 논문에서는 디지털 통신에서 스케일링 함수(scaling function)와 웨이브릿(wavelet)을 이용한 새로운 웨이브릿 편이 변조(wavelet shift keying) 시스템을 제안한다. 웨이브릿 변환은 저주파 계수와 고주파 계수로 구성된다. 입력이 1인 신호에 대하여 임펄스 응답을 구하면, 스케일링 함수와 웨이브릿 함수로 나누어진다. 스케일링 함수를 1로, 웨이브릿 함수를 0으로 할당하여 2진 데이터를 변조한다. 모의실험 결과 제안한 알고리즘이 잡음에 강인함을 확인하였다.
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[게시일 2004년 10월 1일]
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