Proceedings of the KIEE Conference (대한전기학회:학술대회논문집)
- 2002.11c
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- Pages.593-596
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- 2002
Design of a 2.5 Gb/s Clock and Data Recovery Circuit
2.5 Gb/s 클럭 및 데이터 복원 회로의 설계
- Lee, Young-Mi (School of Electronical Engineering and Computer Science, Kyungpook National Univ.) ;
- Woo, Dong-Sik (School of Electronical Engineering and Computer Science, Kyungpook National Univ.) ;
- Lee, Ju-Sang (School of Electronical Engineering and Computer Science, Kyungpook National Univ.) ;
- Kim, Kang-Wook (School of Electronical Engineering and Computer Science, Kyungpook National Univ.) ;
- Yu, Sang-Dae (Kyungpook National Univ.)
- 이영미 (경북대학교 대학원 전자공학과) ;
- 우동식 (경북대학교 대학원 전자공학과) ;
- 이주상 (경북대학교 대학원 전자공학과) ;
- 김강욱 (경북대학교 대학원 전자공학과) ;
- 유상대 (경북대학교 전기전자컴퓨터학부)
- Published : 2002.11.30
Abstract
A design of clock and data recovery (CDR) circuit for the SONET OC-48 using a standard 0.18
Keywords